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“关键路径要的不是总长最短,是单条路径延迟最小。总长最短,可能让一百条普通线各短了o.1毫米,但让一条关键路径长了1毫米。算总账是赚了,但时序收不住了。”
汪涵教授盯着图纸又看了一会儿。
“你说得对。”
他点了点头,“目标函数要改。”
钱兰接了一句:“不只要改目标函数。布线的时候,算法不知道哪条线是关键路径,哪条线不是。得在布线之前,先把关键路径标记出来。”
汪涵教授转过头看着她。
钱兰继续说:“设计师在做逻辑设计的时候,心里是有数的。这条加法器进位链,从仿真就能看出来是时序关键。他可以在布局阶段就把这条路径标记为‘关键路径组’,告诉布线器‘这几条线,优先级最高,不惜代价拉直’。”
汪涵教授拿出笔记本,写了一行伪代码,思路清晰地表达了出来:
“设计师标记关键路径组→布局器优先放置相关单元,缩短距离→布线器为这些路径分配最短走线,允许绕过标准单元、允许牺牲周边线长→布线完成后自动检查延迟,不达标则局部重布。”
他写完,盯着看了两秒,然后点了点头。
“这个可以做。”
诸葛彪把烟叼在嘴角,含混地说:“还有串扰的问题。cad版没自动加屏蔽地线,相邻线间距全按同一规则。您那个布线算法里,串扰约束只有一条‘间距不小于最小间距’。但敏感信号和普通信号,不能一个待遇。”
汪涵教授又写了一行伪代码:
“敏感信号标记→布线时自动增加间距、两侧插入地线、禁止临近大电流开关信号。”
他写到一半,停下来,想了想,又加了一行:
“布线完成后自动运行串扰分析,高风险区域局部重布。”
他把这行字又看了一遍,然后抬起头,看着吕辰。
“你说的敏感信号,具体指哪些?”
吕辰走到白板前,拿起红笔,写了几行字。
“时钟信号。时钟沿的抖动和毛刺直接影响全系统时序,必须隔离。”
“复位信号。复位线上的毛刺可能导致系统误复位,整机死机。”
“模拟信号。adc、dac的输入输出,对噪声极其敏感。”
“高并行总线。数据总线的相邻线串扰会导致数据错误。”
他放下笔,转过身。
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