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“想过。”
吕辰说,“这次流片暴露出来的问题,有一半以上是仿真能力不足导致的,系统需要升级。”
宋颜点了点头:“说说你们的想法。”
吕辰从兜里掏出笔记本,翻开一页,上面密密麻麻写着字。
“时序仿真要升级。现在的Rc模型太理想化,实际版图的寄生参数导致延迟比仿真值大3o~5o%。16位加法器的进位传递链就是典型案例。”
他在纸上画了一个简图。
“升级后的系统,要能提取寄生参数,从版图几何形状提取电阻、电容,生成带寄生的网表,而不是用理想导线模型。关键路径延迟从猜变成算。”
“要有线负载模型,建立不同长度、不同层金属的单位长度Rc值查表,根据线长估算延迟。布局布线阶段就能预估延迟,不用等版图画完。”
“标准单元时序库,每个标准单元提供输入转换时间→输出延迟+输出转换时间的查找表,而不是固定延迟值,级联延迟计算才会更准确。”
“要有时序分析报告,自动找出所有时序路径中最差的那几条,标注延迟值、路径长度、经过哪些单元,不用人工猜关键路径在哪儿。”
“要有时钟树综合辅助,提供时钟树布线指导,估算负载、推荐缓冲器插入位置、计算各分支延迟差,减少时钟偏斜。”
宋颜在笔记本上记着:“Rc提取算法、时序模型,这些功能,得理论组去做!”
吕辰点点头:“理论组做这些不难,但需要扩充午马机的存储容量,版图几何数据量很大。”
宋颜点了点头:“继续。”
钱兰接过话头:“功耗分析要升级。”
她翻开自己的笔记本。
“功耗仿真用平均活动因子,实测动态功耗比设计值高。输出级同时翻转时的电流尖峰被严重低估。”
“要能动态功耗仿真,模拟所有信号同时翻转的最坏情况,而不是平均情况。”
“要建立电源网格模型,计算每颗标准单元的供电电压,现局部电压不足导致的逻辑错误。”
“要建立输出负载建模,精确建模Io引脚的总线负载电容,让输出级尺寸设计有依据,不会过大或过小。”
“要有静态功耗分析,统计所有关断晶体管的漏电流,现漏电过大的单元或工艺问题。”
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